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1.
《武汉职业技术学院学报》2019,(6):99-103
分析目前时间同步技术现状,阐述IEEE1588时间同步原理,为了满足分散控制系统对时钟高精度的要求,给出IEEE1588在分散控制系统中的应用方案,详细介绍系统中对时的具体实施方法。实践证明,该对时方案精度高、成本低。 相似文献
2.
刘焕茹 《石家庄职业技术学院学报》2011,23(6):22-26
针对大型公共场合需放置多台同步时钟的问题,提出了基于无线数传模块和GPS的时钟信息显示系统设计方案.它利用GPS实现准确授时、无线数传模块实现数据传输、时钟芯片实现时钟信息的存储和更新、8英寸数码管实现时间显示.该时钟信息显示系统的时间同步于GPS授时,走时准确,安装方便. 相似文献
3.
数字化变电站合并单元同步问题的研究 总被引:1,自引:0,他引:1
根据同步的协议不同,分别比较多MU同步方式PPS、NTP和IEEE1588等的精度和工程实现难易程度.最后提出各种同步方式各有利弊.在实际工程中,需要综合考虑对同步性能的要求、工程开支,以及变电站系统构架等选择合适的同步方式. 相似文献
4.
欧阳明星 《实验室研究与探索》2013,32(7):258-262
针对传统时钟走时不准,调校不方便的缺点,提出一种基于无线通信网及GPS的双时钟源授时系统设计,主机接收GPS卫星时间信号,通过无线通信网发送给所有子系统实现授时。为提高系统可靠性,设计DS12C887为主机备用时钟源,以备应急时使用,主机通过Internet网关接入互联网,实现远程控制及网络授时。系统硬件电路以STM8及STM32处理器为核心,使用CC1101射频通信模块构建无线通信网,设计无线通信协议及其组网策略,文章最后给出软件设计流程图。样机用于校园授时,控制打铃仪和万年历授时,运行稳定可靠。 相似文献
5.
近几年来,随着科学技术的进步和时代的发展,人们对时间精度提出了越来越高的要求,特别是在国防、科研及电力、铁道、交通、航海等方面,所以,研制高精度时钟系统已越来越重要。现用Motorola公司的GT-on-core GPS接收模块来制作高精度时钟系统。 相似文献
6.
IEEE1588精密时间协议(PrecisionTimeProtocol,PTP)是专门为测量和控制领域制定的一个时间同步协议。研究了在支持VLAN的二层交换机中如何充分利用VLANTag字段来提高PTP数据包在二层交换机当中的转发优先级,从而减小了PTP数据包在网络传输中引起的抖动和误差,实现了纳秒级的精度。 相似文献
7.
本文详细分析了IEEE1588时钟同步的基本原理,并在此基础上给出一种改进的时间同步方法。该改进的时钟同步算法针对网络传输路径的不对称性引入加权因子,用一定时间窗内的主从时钟偏差样本的算术平均值而不是直接利用主从时钟偏差来调整从时钟,并根据算法的状态改变时间窗N的大小,同时利用方差阈值滤波的方法过滤跳变过大时钟偏差测量值,保证同步算法的稳定性。最后给出Alcatel-Lucent TSS5R系统在实验室的时间性能实验结果。实验结果表明TSS5R时钟同步具有稳定的性能,同步精度达到亚微秒级,可满足PTN产品高精度时钟同步的要求。 相似文献
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9.
介绍了数字变电站合并单元使用中的关键技术。首先对比分析了GPS,SNTP,IEEE1588时间同步方法的特点,对目前实际采用的电子式互感器与合并单元之间的数字接口方案进行归纳总结,然后分别进行了基于IEC 61850-9-1和IEC 61850-9-2的合并单元的功能模块分析,最后综述了合并单元的性能测试方案。 相似文献
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A clock synchronization method based on IEEE 1588 and its implementation on Ethernet 总被引:1,自引:0,他引:1
We presented a clock synchronization method that contained a clock adjusting algorithm and a frequency compensated clock to achieve precise synchronization among distributed clocks based on IEEE 1588 protocol. Further, we presented its application on Ethernet and implementation of the frequency compensated clock in a field programmable gate array (FPGA) as experiments. The results indicate that this method can support sub-microsecond synchronization with inexpensive standard crystal oscillators. 相似文献
12.
本文在分析SDH同步网技术和同步时钟控制方式的基础上,提出SDH同步网中光电转换模块的硬件系统的设计方案,从逻辑上进行了模块划分并确定了各个模块要实现的功能,详细介绍了关键芯片选取的型号和特征,重点分析了CPU和控制电路的具体实现方案,对其它相关模块的硬件实现也有论述. 相似文献
13.
介绍了武汉轨道交通AFC(Automatic Fare Collection)系统的基本构成和实现,在此基础上阐述了AFC系统与通信GPS时钟同步实现的原理,并对时钟同步差错控制的实现方法进行了探讨。 相似文献
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Considering the increasing use of information technology with established standards, such as TCP/IP and XML in modem industrial automation, we present a high cost performance solution with FPGA (field programmable gate array) implementation of a novel reliable real-time data transfer system based on EPA (Ethemet for plant automation) protocol and IEEE 1588 standard. This combination can provide more predictable and real-time communication between automation equipments and precise synchronization between devices. The designed EPA system has been verified on Xilinx Spartan3 XC3S1500 and it consumed 75% of the total slices. The experimental results show that the novel industrial control system achieves high synchronization precision and provides a 1.59-ps standard deviation between the master device and the slave ones. Such a real-time data transfer system is an excellent candidate for automation equipments which require precise synchronization based on Ethemet at a comparatively low price. 相似文献
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王永学 《深圳职业技术学院学报》2010,9(3):3-6
在基于IEEE802.11b标准的无线局域网中,提出一种简单的同步算法.该算法根据帧头数据的巴克码自相关特性,通过能量累加和峰值位置比较找到帧头,实现粗同步;然后对帧头数据解调并找到SFD字段,从而实现系统的精确同步.仿真结果表明,算法在信噪比较差的情况下也能精确实现系统同步,且便于硬件实现. 相似文献
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LIU Peng XIA Bing-jie TENG Zhao-wei 《浙江大学学报(A卷英文版)》2007,8(4):631-637
Floorplan, clock network and power plan are crucial steps in deep sub-micron system-on-chip design. A novel di- agonal floorplan is integrated to enhance the data sharing between different cores in system-on-chip. Custom clock network con- taining hand-adjusted buffers and variable routing rules is constructed to realize balanced synchronization. Effective power plan considering both IR drop and electromigration achieves high utilization and maintains power integrity in our MediaSoC. Using such methods, deep sub-micron design challenges are managed under a fast prototyping methodology, which greatly shortens the design cycle. 相似文献